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Un'architettura hardware efficiente per la crittografia multimediale

About Un'architettura hardware efficiente per la crittografia multimediale

Questo libro introduce uno schema di sicurezza zero-overhead per sistemi di elaborazione di immagini digitali incorporati in tempo reale. Il blocco di compressione della trasformata wavelet discreta (DWT) è costruito utilizzando un approccio parametrico, introducendo un parametro libero nel progetto. Per creare questo blocco di compressione DWT parametrizzato, utilizziamo un banco di filtri wavelet biortogonali. Questo approccio consente di creare uno spazio-chiave per la crittografia multimediale leggera. La parametrizzazione produce coefficienti razionali, che si traducono in un'efficiente implementazione hardware a virgola fissa. Raggiungendo una velocità di clock di oltre 244 MHz su un FPGA Virtex 2P di Xilinx, questo metodo si dimostra molto efficace. Il confronto con gli approcci esistenti evidenzia i vantaggi significativi in termini di throughput e di overhead hardware dell'integrazione delle funzioni di sicurezza nell'architettura DWT.

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  • Language:
  • Italian
  • ISBN:
  • 9786207193646
  • Binding:
  • Paperback
  • Pages:
  • 184
  • Published:
  • February 22, 2024
  • Dimensions:
  • 150x12x220 mm.
  • Weight:
  • 292 g.
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Description of Un'architettura hardware efficiente per la crittografia multimediale

Questo libro introduce uno schema di sicurezza zero-overhead per sistemi di elaborazione di immagini digitali incorporati in tempo reale. Il blocco di compressione della trasformata wavelet discreta (DWT) è costruito utilizzando un approccio parametrico, introducendo un parametro libero nel progetto. Per creare questo blocco di compressione DWT parametrizzato, utilizziamo un banco di filtri wavelet biortogonali. Questo approccio consente di creare uno spazio-chiave per la crittografia multimediale leggera. La parametrizzazione produce coefficienti razionali, che si traducono in un'efficiente implementazione hardware a virgola fissa. Raggiungendo una velocità di clock di oltre 244 MHz su un FPGA Virtex 2P di Xilinx, questo metodo si dimostra molto efficace. Il confronto con gli approcci esistenti evidenzia i vantaggi significativi in termini di throughput e di overhead hardware dell'integrazione delle funzioni di sicurezza nell'architettura DWT.

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